wie implementiert eine fpu multiplikation?
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hallo,
ich versuche gerade mit ganzzahlen gleitkommazahlen zu simulieren. allerdings frage ich mich jetzt wie eine fpu die multiplikation (und division) implementiert.
hat jemand links auf entsprechende dokumente?ps: nein, ich glaube nicht dass meine fpu meine programme ausbremst :p
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guckst du hier
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sehr witzig (vorsicht ironie). wenn man danach sucht, kommen nur links zu erklärung des ieee standards.
ich frage:
wie kriege ich z.b. mit einer 64bit zahl heraus, ob die multiplikation meiner beiden 64bit zahlen überlaufen wird? ich könnte die zwar einfach auf 32bits zusammenstauchen, allerdings habe ich dann keine 53bit mantisse wie bei doubles.